25
Twitter/GitHub: @shtaxxx IPSJ-ONE 2017

ゆるふわコンピュータ (IPSJ-ONE2017)

Embed Size (px)

Citation preview

Page 1: ゆるふわコンピュータ (IPSJ-ONE2017)

Twitter/GitHub: @shtaxxx

IPSJ-ONE 2017

Page 2: ゆるふわコンピュータ (IPSJ-ONE2017)

Twitter/GitHub: @shtaxxx

IPSJ-ONE 2017

Page 3: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 4: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 5: ゆるふわコンピュータ (IPSJ-ONE2017)

J

Page 6: ゆるふわコンピュータ (IPSJ-ONE2017)

IntelIntel Core i7

#include <stdio.h>int main(){printf("Hello!¥n");return 0;

}

Page 7: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 8: ゆるふわコンピュータ (IPSJ-ONE2017)

FPGA

Page 9: ゆるふわコンピュータ (IPSJ-ONE2017)

[1] Agile Co-Design for a Reconfigurable Datacenter, FPGA'16

Page 10: ゆるふわコンピュータ (IPSJ-ONE2017)

Digilent PYNQ-Z1Python$229 (Academic $65)

Page 11: ゆるふわコンピュータ (IPSJ-ONE2017)

ScalableCore System(Xilinx Spartan-6 128)

CPU100

Page 12: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 13: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 14: ゆるふわコンピュータ (IPSJ-ONE2017)

L

Page 15: ゆるふわコンピュータ (IPSJ-ONE2017)

int main(){

return 0;} J

Page 16: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 17: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 18: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 19: ゆるふわコンピュータ (IPSJ-ONE2017)

J

Page 20: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 21: ゆるふわコンピュータ (IPSJ-ONE2017)

conv1_input_enable:1 delayR

conv1_input_act_0_0:8 *L

conv1_input_wgt_0_0:8

R

conv1_input_act_0_1:8

*

L

conv1_input_wgt_0_1:8 R

conv1_input_act_0_2:8

*L

conv1_input_wgt_0_2:8 R

conv1_input_act_1_0:8 *L

conv1_input_wgt_1_0:8

R

conv1_input_act_1_1:8

*L

conv1_input_wgt_1_1:8 R

conv1_input_act_1_2:8

*L

conv1_input_wgt_1_2:8 R

conv1_input_act_2_0:8

*

L

conv1_input_wgt_2_0:8 R

conv1_input_act_2_1:8

*

L

conv1_input_wgt_2_1:8 R

conv1_input_act_2_2:8

*L

conv1_input_wgt_2_2:8

R

delayR

*

*

*

*

*

*

*

*

*

delayR

*

*

*

*

*

*

*

*

*

delayR

*

*

*

*

*

*

*

*

*

delayR

*

*

*

*

*

*

*

*

*

delayR

*

*

*

*

*

*

*

*

*

delayR

*

*

*

*

*

*

*

*

*

delayR

+L

R

delayR

+L

R

delayR

+L

R

delayR

delayR

+L

R

+L

R

+

L

R

delayR

+L

R

delay

R

delayR

+L

R

delayR

<

L

delayR

delayR

Cond0

2

conv1_act_output_valid:1

conv1_act_output:80 R

0

1

Page 22: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 23: ゆるふわコンピュータ (IPSJ-ONE2017)
Page 24: ゆるふわコンピュータ (IPSJ-ONE2017)

IntelIntel Core i7

#include <stdio.h>int main(){printf("Hello!¥n");return 0;

}

FPGA

Page 25: ゆるふわコンピュータ (IPSJ-ONE2017)